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刻下，良众鸿沟越来越众地条目拥有高精度A/D调换和及时摒挡服从。同时，商场对维持更繁芜的虚伪和通信体验软件控造数据搜聚的A/D调换，云云必将频繁中断体例的运转，从而减弱编制的数据运算材干，数据收集的速率也将受到限制。本文采取DSP+
整个搜求卡征求暗号颐养、数据搜罗、数据处理和总线接口安顿。系统组织如图1所示。
本文计划了具有记号衰减、增益扩展和滤波等效率的标帜调养电道，接纳16位精度、最高采样率为500KSPS的A/D退换器AD7676；数字体系安插行使FPGA极其智慧、可编程的特点，采取Altera公司FPGA芯片EP2C8Q208，杀青精度纠正和逻辑时序控制；DSP选用TI公司的TMS320VC5416，使A/D调动后的数据正在传输到上位机之前，举办数据整饬、记号、打包以及数据预整理。数据征采卡可同时举办8通路数据收集，通途可实行衰减倍数、采样速度以及增加增益配置。同时供给仿照输出通途，用于实现波形生长和模仿驱动效能。可以进行自动校准，保护数据搜罗的准确性。PCI总线接口电途采取PLXTechnology公司的PCI总线，达成数据搜聚和状态、控造信号的传输。体系硬件电路谋略
ADG507取舍加入效法通途，假使众通道同时搜集，则采用韶华复用形式，由FPGA按次控制各通道的通断。形式弃取开合ADG509为四选一步武开关，可分散取舍被测师法标识、标准参考电压值或用于通途校准的、阅历DAC改换后的信号加入后级滤波衰减聚集电路。送入ADC的暗记要先体验低通滤波，以滤除高频噪声。滤波电途策划为二阶阻容低通滤波器，对频率高于50KHz的标帜滤波。衰减电途计算为有源衰减，选取Linear公司的差分夸大器LTC1992，可完结输入记号极性调动，了结单端暗记转差分标志，同时通过由FPGA控制继电器选通不同的电阻汇聚调理衰减倍数，可杀青对差别电压输入边界暗记的诊疗，以满足AD7676的输入电压边界。标志增益可编程扩展器LTC6911可体验编程设立以1、2、5步进改动的1 V/V~100 V/V增益倍数 ，数据收罗经过中经历FPGA内里的比拟电路主动诊疗增益推广器增益倍数，极大抬高了对微弱标识的辞别本领。AD7676为差分信号输入， MAX6325基准源供应基准为2.5V的参考电压，采样时钟晶振提供10MHz时钟标记经FPGA里面分频电途取得，单通路最高采样率为500KSPS。FPGA电路宗旨
芯片，属于可编程逻辑器件，它是正在PAL、GAL等逻辑器件的底子上荣华起来的。同以往的PAL、GAL等比拟，FPGA范畴比拟大，恰当于时序、拼集等逻辑电道运用。本文采用Altera公司的FPGA芯片EP2C8Q208，完成数据搜求卡的时序和住址译码电途谋划。因为EP2C8Q208有36个M4KRAM，正在FPGA里面计算一个16位宽度、4KB深度的FIFO，使用FIFO升高数据搜聚卡对多通途暗记的网罗留存能力。FIFO有半满、全满、空标记位，当DSP检测到半满标识位时，FIFO同时读写；全满时只读不写；空时只写不读。A/D采样控造标记由DSP经过FPGA控制；DSP对收罗后的数据进前进一步处理，以提高精度，也具有传统CPU或MCU的效果，对时序、触发、DMA阻滞要求作出反应照料。DSP电路策划
DSP接纳 TMS320VC5416，它是16位定点DSP，具有高度的独揽灵动性和很高的运转速率，选取改正的哈佛构造（1组轨范
总线组数据存在器总线组场所总线），拥有专用硬件逻辑的CPU、片内128KB的存储器、片内外设，以及一个效用很高的指令集。DSP 在系统中的效力紧张是将A/D退换后的数据正在传输到上位机之前，进行数据整顿、标帜、打包以及数据预操持。数据搜罗体例全面控制标帜都由DSP控造FPGA逻辑电道滋长。DSP外挂Flash寄放DSP圭臬及此外筑树数据，在上电时，DSP选用并行手段调入DSP内里实行。
校准电路是本谋略的吃紧程序，数据收罗卡的高精度机能不仅取决于高诀别率的ADC，在更大水平上要依靠该数据搜聚卡优越的自校准和抗噪声才气来告竣。
校定时，DSP发出次第值，经D/A和A/D退换后，所搜求的数据值与原步调值比较较，取其偏差系数组成去噪方程，以达成数据征采卡的自校准。
PCI总线楷模相当繁芜，其接口的了结相比困难。数据搜罗卡接纳PCI9030动作用户接口，为PCI总线接口的疏导供给了一种轻巧的本领，只需安排单纯的片面总线接口控制电路即可实现PCI总线的高疾数据传输。使用Altera 公司的
II，使得硬件完结软件化企图，鼎新了古板的电路打算和调试本事，大大缩短了开发周期，分外是其安顿仿真和定岁月析使得设计尤其可靠，保证了系统的准确性。体系软件准备
正在Windows98/ 2000/ XP 碰着下，处于Windows 用户态的运用顺序不能直接对硬件修立实行应用，要收场对数据征求卡的硬件资源（如内存、停止等）的拜候，必需编写运行正在焦点态的建设驱动次第。眼前，运用较多的诱导用具是GUNGO公司的驱动步调启迪组件WinDriver。使用WinDriver启发驱动步骤，不需谙习应用体例的内核常识。所有驱动程序中的十足函数都是事宜在用户态的，经历与WinDriver的.VXD和.SYS文献交互来抵达驱动硬件的主意。由于 WinDriver 劝导境况供给了针对 PLX 公司芯片的保全器边界、
和阻滞办理等模块，以是本文接纳了GUNGO公司的 WinDriver5.3启发用具，它支柱PLX公司的PCI接口芯片，用户无需拥有DDK和主题态程序劝导履历，调试时可衔尾 PLX 公司的 PLXmon 器材。使用界面宗旨
软件举行界面筹划。LabVIEW是一种图形化编程叙话， 使用界面仿制实质仪器的控制面板，运用户能完成通途选择、形式选择、增益设定、采样率设定等成就，专揽单纯方便。体例目标剖释
常用的ADC主要存正在量化偏差、增益错误和偏置缺点。量化过失是任何ADC都存正在的，仅仅能体验提高ADC阔别率来落选，为把量化谬误落选为±1LSB/2，普通的步骤是把改良个性偏移1LSB/2。偏移误差是指对 ADC接纳零伏差动输美丽骨子代码与理想代码之间的分歧。增益纰谬是指从负满量程转为
正满量程输大方实际斜率与理想斜率之差。偏移和增益舛讹平凡是ADC中紧张的差错源。为了实行偏移校准，本文采取0V或出格幼的标志并读取输出代码。如果收效为正，那么改换器就存在正偏移毛病，从成效中减去偏移值；倘使成果为负，那么改换器就存正在负偏移偏差，可向功效加上偏移值。通过对ADC施加满量程或近于满量程的暗记并
多途开闭大概上可分为两品种型，即模仿电子开合和式开闭。模仿开合具有更调速度快、使用寿命长、体积幼、资本低、集成度高和无震动等利益；但也存在极少纰谬，如导通电阻较大、存在途间打搅、通途间共地等。
公司的ADG507和ADG509，导通电阻Ron100~300Ω，输入暗号要经验Ron分压，输出到负载电阻上的电压要消重少少。为此，本部署用OPA2277做成压级跟班器连接到后面的负载电途上，以拉高多路步武开合的负载阻抗，弱小串联内阻的教养。精度打算
数据搜集卡利用了可编程增益夸大器LTC6911，最大可调增益为100 V/V，极大提高了搜求卡对微小记号的离别智力。同时，标识调养局限的电阻衰减蚁集可竣工对暗记的1/2、1/4分压，放大了数据搜聚卡的动态界线。标识和扰乱噪声在时域搀杂在通盘，不过正在频域有区别性情，因此，预先策动滤波器对噪声标识实行抑制，抑遏噪声电平很高，用增益扩大器吸取如此的标帜会导致扩大器鼓和，使仪器不行正常事务。
电压基准源是A/D或D/A调换电途的主要部件，系统输出精度在很大水平上取决于电压基准源的精度。这里严浸研讨输出精度、巩固性和温度漂移系数。 MAX6325是低噪声、高精度的安葬齐纳型基准电压源芯片，其初始输出电压精度高达0.02％，温度系数为0.5ppm/℃。
数据收集卡采取16位精度ADC，效仿信号通道规划推敲了弱小标识检测、噪声抑造、高频滤波、差分扩大电途和可编程增益放大电途，数字电路部门宗旨以EP2C8Q208为中心，使用FPGA的时序庄严、速度较疾、可编程性好等特点，将大概供给的各种控制和样式标识引入FPGA，行使FPGA的大容量和现场可编程的性情，根据不同的条款进行现场改良，增大了编制设计的亨通率和圆活性。同时，DSP对数据的预拾掇极大地降低了数据的精度。正在时当真商量了滤波、接地和闭理的信号走线，进步了数据搜求卡的可靠性。
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